주문형 반도체 (ASIC) Floorplan 자동화 - Part III
ASIC floorplan 자동화를 강화학습으로 구현한 장기 프로젝트 결과를 소개했습니다. 엔지니어 대비 수행 시간을 줄이고 PPA 성능도 개선한 사례를 공유했습니다.
#강화학습#ASIC#반도체 설계
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Chip Placement on FPGA 프로젝트를 소개합니다!
FPGA의 소자 배치를 강화학습으로 자동화하기 위한 환경과 에이전트 구조를 소개했습니다.\nGrid·Mask·보상·그래프 임베딩 설계에서의 도메인 특화 고려사항을 정리했습니다.
#강화학습#FPGA#chip placement
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Chip Placement with Deep Reinforcement Learning
Chip Placement를 Hard Macro 순차 배치 MDP로 정의한 Google의 강화학습 방식을 소개했습니다.\nGNN 상태 인코딩과 Wire Length·혼잡도 보상으로 PPA 제약을 근사했습니다.
#ML#강화학습#GNN
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